技术栈
高斯信道
我爱C编程
2 个月前
fpga开发
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verilog
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16qam
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帧同步
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误码统计
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高斯信道
基于FPGA的16QAM+帧同步系统verilog开发,包含testbench,高斯信道,误码统计,可设置SNR
目录1.算法仿真效果2.算法涉及理论知识概要2.1 16QAM调制解调原理2.2 帧同步3.Verilog核心程序
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3 个月前
fpga开发
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qpsk
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帧同步
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硬件片内测试
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高斯信道
【硬件测试】基于FPGA的QPSK+帧同步系统开发与硬件片内测试,包含高斯信道,误码统计,可设置SNR
目录1.算法仿真效果2.算法涉及理论知识概要2.1QPSK2.2 帧同步3.Verilog核心程序4.开发板使用说明和如何移植不同的开发板
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4 个月前
fpga开发
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bpsk
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帧同步
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硬件片内测试
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误码统计
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高斯信道
【硬件测试】基于FPGA的BPSK+帧同步系统开发与硬件片内测试,包含高斯信道,误码统计,可设置SNR
目录1.硬件片内测试效果2.算法涉及理论知识概要2.1 bpsk2.2 帧同步3.Verilog核心程序
我爱C编程
4 个月前
fpga开发
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帧同步
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误码统计
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2fsk
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高斯信道
基于FPGA的2FSK+帧同步系统verilog开发,包含testbench,高斯信道,误码统计,可设置SNR
目录1.算法仿真效果2.算法涉及理论知识概要2.1 FSK调制解调2.2 帧同步3.Verilog核心程序
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4 个月前
fpga开发
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帧同步
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硬件片内测试
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误码统计
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2fsk
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高斯信道
【硬件测试】基于FPGA的2FSK+帧同步系统开发与硬件片内测试,包含高斯信道,误码统计,可设置SNR
目录1.算法仿真效果2.算法涉及理论知识概要2.1 FSK调制解调2.2 帧同步3.Verilog核心程序