技术栈
d触发器
程序员爱德华
10 天前
数字电路
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锁存器
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d触发器
数字电路与模拟电路、System Verilog
模拟是连续不断的，数字是离散跳跃的核心问题：把连续的模拟信号（如声音）变成离散的数字信号（0和1）时，采样率该定多高？
柠檬叶子C
3 年前
fpga开发
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jk触发器
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d触发器
【FGPA】Verilog：JK 触发器 | D 触发器 | T 触发器 | D 触发器的实现
JK 触发器是 RS 触发器和 T 触发器的组合，有两个输入端 J 和 K，如果两个输入端都等于 1，则将当前值反转。
我是有底线的