risc-v

杭州_燕十三

从零开始学习 sg200x 多核开发之 milkv-duo256 编译运行 sophpisophpi 是算能官方针对 sg200x 系列的 SDK 仓库 https://github.com/sophgo/sophpi ，支持 cv180x、cv81x、sg200x 系列的芯片。

安全二次方security²

2024 RISC-V中国峰会安全相关议题汇总安全之安全(security²)博客目录导读第四届 RISC-V 中国峰会（RISC-V Summit China 2024）于8月21日至23日在杭州成功举办。此次峰会汇聚了 RISC-V 国际基金会、百余家重点企业及研究机构，约3000人线下参与，并在19日至25日间举办了超过20场同期活动，与全球开发者共同探讨 RISC-V 的最新进展与未来走向。

安全二次方security²

2024 RISC-V 中国峰会演讲幻灯片和视频回放均已公开目录一、幻灯片地址：二、演讲视频：RVSC2024/slides at main · cnrv/RVSC2024 · GitHub

杭州_燕十三

从零开始学习 sg200x 多核开发之 eth0 MAC 地址修改在 sophpi 中，默认网卡 eth0 的 MAC 地址未配置，是随机生成的。这样就会导致每次重启之后，MAC 地址会改变，从而导致通过 DHCP 获取 IP 地址每次也都在变化。

学习笔记——PLCT汪辰：开发RISC-V上的操作系统（持续更新）目录第0章下载源码运行环境构建和使用说明第1章记录一个本人没听说过的架构第2章~第4章git clone https://gitee.com/unicornx/riscv-operating-system-mooc.git

CSM32RV20：RISC-V核的低功耗MCU芯片，常用在智能门锁上内置RISC-V RV32IMAC内核（2.6CoreMark/MHz）；蕞高32MHz工作频率；内置4kB的SRAM；

飞凌嵌入式

FET113i-S核心板已支持RISC-V，打造国产化降本的更优解 -飞凌嵌入式FET113i-S核心板是飞凌嵌入式基于全志T113-i处理器设计的国产工业级核心板，凭借卓越的稳定性和超高性价比，FET113i-S核心板得到了客户朋友们的广泛关注。作为一款拥有A7核+RISC-V核+DSP核的多核异构架构芯片，全志科技于近期释放了T113-i的RISC-V核（玄铁C906）资料，飞凌嵌入式也快速进行了适配。

RISC-V单片机可快充手持电钻方案分享RAMSUN分享以RISC-V单片机为主控芯片的可快充手持电钻方案。RISC-V单片机特点 -主频高达144MHz -支持单周期乘法和硬件除法器 -支持两级硬件堆栈 -最高64KB Flash，20KB SRAM -双路12位高速ADC，最多支持10路采样通道 -支持通用DMA、USB、CAN、SPI、UART和I2C -内置双路模拟运放比较器

谷公子的藏经阁

RISC-V笔记——显式同步RISC-V的RVWMO模型主要包含了preserved program order、load value axiom、atomicity axiom、progress axiom和I/O Ordering。今天主要记录下preserved program order(保留程序顺序)中的Explicit Synchronization(显示同步)。

码匠许师傅

【开源鸿蒙】OpenHarmony 5.0轻量系统最小开发环境搭建本文将会介绍，如何下载OpenHarmony 5.0源代码和工具链，让磁盘占用尽可能小的同时，还可以进行轻量系统的OpenHarmony开发（即源码编译构建）。最终实现了，从全量源码和工具链占用磁盘空间的67GB减少到15GB。

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RISC-V笔记——内存模型公理在RISC-V中，只有当存在一个全局内存顺序(global memory order)符合preserved program order，并且满足load value axiom、atomicity axiom和progress axiom时，RISC-V程序的执行才遵循RVWMO内存一致性模型。今天主要讲下load value公理、atomicity公理和progress公理。

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RISC-V笔记——重叠地址排序RISC-V的RVWMO模型主要包含了preserved program order、load value axiom、atomicity axiom、progress axiom和I/O Ordering。今天主要记录下preserved program order(保留程序顺序)中的Overlapping-Address Orderings(重叠地址排序)。

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RISC-V笔记——内存模型总结Memory consistency model定义了使用Shared memory(共享内存)执行多线程(Multithread)程序所允许的行为规范。RISC-V使用的内存模型是RVWMO(RISC-V Weak Memory Ordering)，RVWMO内存模型是根据全局内存顺序(global memory order)定义的，全局内存顺序是所有harts产生的内存操作的总顺序。通常，多线程程序有许多不同的可能执行，每个执行都有自己对应的全局内存顺序。

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RISC-V笔记——RVWMO基本体RISC-V使用的内存模型是RVWMO(RISC-V Weak Memory Ordering)，它是Release Consistency的扩展，因此，RVWMO的基本特性类似于RC模型。

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RISC-V笔记——基础RISC-V旨在支持广泛的定制和专业化。RISC-V的ISA是由一个基本整型ISA和其它对基本ISA的可选扩展组成。每个整型ISA可以使用一个或多个可选的ISA扩展进行扩展。

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RISC-V笔记——语法依赖Memory consistency model定义了使用Shared memory(共享内存)执行多线程(Multithread)程序所允许的行为规范。RISC-V使用的内存模型是RVWMO(RISC-V Weak Memory Ordering)，该模型旨在为架构师提供更高的灵活性，以构建高性能可拓展的设计，同时支持可控制的编程模型。RSIC-V其实还支持Ztso扩展，这是为了方便移植x86或SPARC体系结构的代码，这两种体系结构默认情况下都使用TSO内存模型。至于什么是memory model、有

RISC-V知识点目录分支预测分支预测概述https://blog.csdn.net/zhangshangjie1/article/details/136947089?sharetype=blogdetail&sharerId=136947089&sharerefer=PC&sharesource=zhangshangjie1&spm=1011.2480.3001.8118分支指令的方向预测https://blog.csdn.net/zhangshangjie1/article/details/135261303分支预测的地址

【开源】RISC-V 修改neofetch中的Host描述neofetch 是一款用于在终端中显示系统信息的工具，其主要特点是以美观的方式展示宿主机的基本信息。它通常用于展示系统的分发版本、内核版本、硬件信息、桌面环境，以及一些个性化的设置，配合 ASCII 艺术风格的 logo，使得屏幕显得更加引人注目。

毕业设计项目——基于RISC-V的标签化跨层调度应用任务管理（论文/代码）完整的论文代码见文章末尾以下为核心内容在现代操作系统中，高效的系统调度策略对于优化系统性能、提高资源利用率和保证系统稳定性至关重要。本文提出了一个基于Linux进程文件系统（procfs）的系统监控工具，旨在通过实时收集系统运行数据，为系统调度提供精确的决策依据。该监控工具利用Linux特有的/proc文件系统，实时监控CPU使用率、内存占用、网络流量等关键性能指标，支持多线程并行数据收集，以最小化监控过程对系统性能的影响。

分享国产RISC-V单片机通用开源已经成为构建新技术生态的主流趋势。基于开源指令集 RISC-V 的软硬件生态正在飞速扩增，并且已经迅速扩展至个人 PC、服务器和人工智能等领域。RISC-V 的灵活性和可扩展性使其能够在应用处理器和AI加速领域迅速发展。