Xilinx FPGA—— ViVado存储器FIFO IP核

一、什么是FIFO

FIFO 本质上是由 RAM 加读写控制逻辑构成的一种先进先出的数据缓冲器。

FIFO与RAM的区别:

1.FIFO没有外部读写地址线,使用简单

2.FIFO只能顺序写入数据,并按顺序读出数据

3.FIFO地址由内部读写指针自动加 1 完成

4.FIFO可工作在不同时钟域

二、创建FIFO IP核

ViVado的FIFO的实现可配置为资源与种类的7种组合:

|------------------------------------|----------------------|
| Common Clock Builtin FlFO | 同步FIFO,使用内置 FIFO资源存储 |
| Common Clock Block RAM | 同步FIFO,使用RAM快存储 |
| Common Clock Distributed RAM | 同步FIFO,使用分布式RAM存储 |
| Common Clock Shift Register | 同步FIFO,使用移位寄存器存储 |
| Independent Clocks Builtin FlFO | 异步FIFO,使用内置 FIFO资源存储 |
| Independent Clocks Block RAM | 异步FIFO,使用RAM快存储 |
| Independent Clocks Distributed RAM | 异步FIFO,使用分布式RAM存储 |

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