fpga开发

CRC校验代码生成网址CRC（Cyclic Redundancy Check，循环冗余校验）是一种基于多项式除法的错误检测技术，主要用于检测数据传输或存储过程中的比特错误。在FPGA应用中，CRC校验的核心作用是确保高速数据通道的完整性，典型应用场景包括：

AMBA总线（15）关于AXI-stream（sg模式）SG模式的典范-----最有魔力的协议，大家要好好学。网络都是它。本篇文章给讲讲AXI-stream。该协议在AMBA4中推出，AMBA4中总共有以下三种跟AXI相关的协议：

Quartus Prime 新手完全使用指南Quartus Prime 是 Intel（原 Altera）推出的 FPGA/CPLD 集成开发环境，也是数字电路设计、FPGA 开发入门的核心工具。对于刚接触 FPGA 的新手来说，Quartus 的操作流程和功能模块看似复杂，但只要掌握 “工程创建 — 代码编写 — 编译验证 — 硬件下载” 的核心逻辑，就能快速上手。

三种主流接收机架构（超外差、零中频、射频直采）对比及发展趋势浅析接收机作为无线通信、雷达、卫星通信等电子系统的核心组成部分，其架构设计直接决定了系统的性能指标、集成度、成本及功耗。当前主流的接收机架构主要包括超外差接收机、零中频接收机（以AD9361/ADRV9009为代表）和射频直采接收机（以RFSoC为代表）。本报告将系统分析三种架构的核心原理、优势与不足，并结合技术演进趋势预判其未来发展方向，为相关系统设计与选型提供参考。

一颗数字系统是如何在 FPGA 上“跑起来”的？一颗数字系统是如何在 FPGA 上“跑起来”的？对行业稍有涉猎的同学，往往也能给出一个朴素的答案：先写 RTL，再综合、实现，最后下载到板子上验证。

FPGA JTAG接口设计全解析JTAG (Joint Test Action Group) 是 FPGA 开发中最重要的接口，没有之一。它的主要作用有两个：

iverilog 配合 Makefile 搭建 Verilog 仿真工程ModelSim 配合 Makefile 搭建 Verilog 仿真工程iverilog-v11-20190809-x64_setup.exe 安装

芒果树技术

MangoTree案例分享：基于AtomRIO FPGA平台，客户实现自适应主动减振现代工业飞速发展，仪器设备功率与转速持续提升，振动的危害也越来越突出 —— 不仅影响产品质量与操作精度，还会缩短设备寿命、危及使用安全，因此，掌握振动控制已成为各国工业发展的重要课题。

按键电路设计的细节目录1.按键简介1.1. 名字1.2. 为什么要 4 个脚？（内部结构揭秘）1.3. 原理图中的画法（红线的意思）

vio_uart的浏览器版上位机vio_uart 是我在 FPGA 调试过程中设计的一种6字节定长轻量通信协议，适用于寄存器读写与 RPC 调用，遵循严格的一问一答机制。vio_uart 上位机可以使用 JavaScript 在浏览器中灵活编排测试流程，实现快速调试和测试。

不吃鱼的羊

达芬奇PWM模块PwmChannelClass通道类型。PWM_FIXED_PERIOD：只能修改占空比。pwm_fixed_period_shifts：只有占空比可以改变。PWM_VARIABLE_PERIOD：可修改占空比和周期。

京微齐力FPGA联合modelsim仿真操作使用FUXI关联modelsim直接仿真，这种操作一般是在纯逻辑代码，没有IP核时，使用最为方便，但是如果有IP，这种操作方法容易报错，所以做仿真之前做好选择

zynq上用verilog实现单稳态电路该单稳态verilog模块，要求触发当输入收到由低变高后，输出一个高电平。高电平的时间根据五个输入离散量值delaycount延时，总延时时间等于90us乘delaycount。模块输入包括reset#异步复位，clk为50Mhz。

在ubuntu中安装modelsim(1)下载modesimwget http://download.altera.com/akdlm/software/acdsinst/13.1/162/ib_installers/ModelSimSetup-13.1.0.162.run chmod +x ModelSimSetup-13.1.0.162.run

SURF：SLAC 开源 FPGA 与 ASIC 通用 RTL 框架详解之前文章《使用 IP 核和开源库减少 FPGA 设计周期》中介绍过SURF开源库，今天我们就展开讲讲SURF，重点介绍能为我们带来哪些便利。

FPGA在工业控制行业的应用，行业研究文章FPGA（现场可编程门阵列）是工业控制领域硬实时、高并行、高可靠的核心核心器件，区别于MCU/PLC/ARM处理器的串行执行、软件调度特性，FPGA以硬件并行逻辑、纳秒级响应、可重构硬件架构、抗强电磁干扰为核心优势，完美适配工业控制中实时性要求极致、多通道并行处理、复杂协议硬核解析、恶劣环境稳定运行的刚需，是工业4.0/智能制造中高端控制、精密测控、异构计算的核心载体。

【Xilinx FPGA】CLB SliceL 与 SliceMXilinx 7 系列 FPGA 包括三个家族：Artix-7、Kintex-7 和 Virtex-7，它们共享相同的 CLB 架构。这个架构与 Virtex-6 FPGA 的 CLB 相同，但与 Spartan-6 有些差异，主要是列式架构且只保留 SliceL 与 SliceM 类型单元。本文主要介绍 Xilinx 7 系列 FPGA 中的可配置逻辑块（CLB）的架构、功能与设计方法。

集芯微电科技有限公司

PC1001超高频率（50HMZ）单通单低侧GaN FET驱动器支持正负相位配置概述：PC1001 是一款单通道高速驱动器，具有 5V 输出和专用增强型氮化镓（GaN）场效应晶体管（FET）驱动功能。PC1001 可提供非对称峰值电流驱动能力，源电流为 1.4A，灌电流为 4A，分别可优化器件的导通和关断时间。PC1001 提供反相和非反相输入，以满足单个器件类型中对反相和非反相门驱动的需求。当输入引脚悬空时，内部输出上拉和下拉电阻会使输出保持低电平。PC1001 具有欠压锁定功能，在 VDD 电源电压进入工作范围之前，可使输出保持低电平。

FPGA学习笔记（8）以太网UDP数据报文发送电路设计（二）1.主要精力放到 UDP（课设要做的“数据报发送/回环/上层业务”）2.ARP模块：让电脑通过 ARP 得到你的 MAC（不然电脑发不了 IP/UDP 给你）

FPGA_小田老师

FPGA例程（3）：按键检测实验本专栏主要针对与想学习FPGA的同学，从基础的点灯到之后的复杂功能实战例程，从入门到进阶，通过这些例程的学习和了解，希望可以帮助你从一个FPGA小白进阶到FPGA中级阶段，能够处理工作中大多数的FPGA使用场景。