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USB通信在FPGA上怎么实现？在嵌入式开发和高速数据采集领域，将USB通信与FPGA（现场可编程门阵列）结合，一直是许多工程师关注的“硬骨头”。为什么大家非要折腾这个？因为传统的MCU在处理超高速、多通道并行数据时往往力不从心，而FPGA凭借其强大的并行处理能力和灵活的逻辑定制优势，完美契合了工业控制、医疗影像、高速示波器等场景对实时性和带宽的严苛要求。

LCD显示技术完全指南：原理·制造·驱动·FPGA实现之基础二上一篇我们弄懂了LCD的核心是“百叶窗”——液晶分子在电场下集体转向，控制光线通过量。但问题来了：一块1080p的屏幕有超过200万个像素，你怎么可能为每个像素单独拉一根导线去控制它的电压？答案就是藏在玻璃基板上的那个“小开关”——薄膜晶体管（TFT）。这一篇我们来拆解这个开关的逻辑，顺便回答一个经典面试题：存储电容是干什么用的？

基于FPGA的卷积神经网络实现-Step2 卷积模块设计文档说明：本文档是 Step 2——CNN 流式卷积加速器的子模块级详细设计报告。Step 1 建立了"分块 + 迭代"的数学框架并论证了算子层可行性；Step 2 在此基础上将理论落地为硬件微架构，聚焦于单个子模块 Conv_Kernel.V 的完整 RTL 设计。全文覆盖 Step1 核心回顾、模块接口与数据格式、五级流水线详细设计、BRAM 与 FIFO 资源计算以及多层次验证策略。所有设计同时覆盖 C S I Z E = 3 C_{SIZE}=3 CSIZE=3（9 子模块）和 C S I Z E

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黑猫学长呀

存储宝典第6篇：测试机台的PE板和PPB板有什么区别？文章为个人辛苦整理，付费内容，已加入原创侵权保护，禁止私自转载。文章所在专栏：《黑猫存储芯片宝典》测试机台的PE板和PPB板有什么区别？ ppb 是协议板卡，专门实现了协议；PE是刻时钟的通道，类似FPGA那种。

LCD显示技术完全指南：原理·制造·驱动·FPGA实现之基础一你在调试LCD驱动时，有没有遇到过这种困惑：为什么液晶必须用交流驱动？为什么直流偏置会让屏幕“烧坏”？为什么不同角度看到的颜色和亮度不一样？别急着看时序图，我们先回到物理原点——理解LCD的本质是一排“百叶窗”，而不是一盏灯。

TopJTAG Probe连接zynqTopJTAG Probe 是一款功能强大的硬件调试与编程工具，主要用于嵌入式系统开发、芯片测试和固件烧录等领域。它通过标准的 JTAG（Joint Test Action Group）接口与目标设备连接，为开发者提供了对芯片内部寄存器、内存和逻辑单元的深度访问与控制能力。

RFSOC+VU13P/VU9P+GPU多通道同步一体化解决方案RFSOC+VU13P/VU9P+GPU多通道同步一体化解决方案，满足通信、雷达、电子对抗、通感控算、AI无线感知等领域的通用方案设计，满足客户快速搭建验证整机平台，完成试验验证与测试的条件。系统整体构架方案如下图所示。

ALINX技术博客

【黑金云课堂】FPGA技术教程Linux开发：串行通信接口与实时时钟模块Linux 应用第 16-19 节串行通信接口与实时时钟模块，选自 ALINX 黑金云课堂 FPGA 免费直播课。该课程由 ALINX 资深工程师团队倾力打造，从 0 到 1 系统化教学，帮助每位工程师跨过 FPGA 开发门槛。

国产ZYNQ multiboot功能介绍与实现当前因为国产化的需要，项目中几乎都用国产芯片，但国产芯片有时候不太稳定，就拿国产flash芯片来说，小概率会出现flash内存储的数据发生异常，导致系统无法启动。在这种背景下，引入了国产zynq的multiboot功能。

DDR3速率分档根据JEDEC官方定义的DDR3标准频率（标称频率）包括以下6个等级： ‌ DDR3-800‌ ‌ DDR3-1066‌ ‌ DDR3-1333‌ ‌ DDR3-1600‌ ‌ DDR3-1866‌ ‌ DDR3-2133 但经常在一些文档或软件中还会看到在每一等级后面还会加个后缀，比如 DDR3-800D，DDR3-800E，DDR3-1600G，DDR3-1600H等等，那这些后缀又表示什么呢。

坏孩子的诺亚方舟

open_prj22_IIC读写EEPROM、AD/DA、PLSYSMONa）EEPROM(Electrically Erasable Progammable Read Only Memory，E2PROM)是指带电可擦可编程只读存储器，是一种常用的非易失性存储器（掉电数据不丢失），E2PROM有多种类型的产品，我们开发板上使用的是ATMEL公司生产的AT24C系列的AT24C64这一型号。AT24C64具有高可靠性，可对所存数据保存100年，并可多次擦写，擦写次数达一百万次。

仿真xilinx库加glbl()的作用在仿真带xilinx库的 testbench（仿真顶层）里都有这一行： glbl glbl(); 必须在顶层显式调用，不加仿真直接跑不起来。那具体作用是什么呢。

基于FPGA的卷积神经网络实现-方案构想在实时图像处理场景中，卷积运算是整个流水线里最耗时的环节。一个 3 × 3 3\times3 3×3 的卷积核对一张 128 × 128 128\times128 128×128 的图像就要完成近 15 万次乘累加；换成 5 × 5 5\times5 5×5 的核，这个数字轻松突破 40 万。更棘手的是，像素并不会一次性全部摆在我们面前——在流式场景下，数据是按逐行或者逐列扫描顺序、一个时钟周期一个像素（或者是burst）地"滴答"到来的。

全频段 SDR干扰源模块解决方案（星链干扰、LORA无人机干扰）超带宽全频段SDR干扰源模块是一款高频段、多通道、宽实时带宽的通用干扰源，覆盖全频段，支持多制式调制与快速跳频，可满足通信、雷达、电子对抗等场景的信号模拟需求，功能可扩展。

FPGA JTAG确认1 JTAG烧录引脚 2. 状态不同封装的引脚EXCEL/XML对应原理图通过Diamond软件确认引脚 tools/spreadsheet View/Dual function

北京青翼科技

基于VITA57.1的2路125MSPS AD采集、2路250MSPS DA回放FMC子卡丨青翼科技100%国产采集卡产品概述FMC164G是一款基于VITA57.1规范的2路125MSPS采样率 16 位分辨率AD采集、2路250MSPS采样率16位分辨率DA回放 FMC子卡模块。该模块遵循VITA57.1规范，可直接与符合VITA57.1 规范的FPGA载卡配合使用，板卡ADC器件采用上海贝玲的AD9268 芯片，板卡DAC器件采用重庆吉芯的AD9747芯片。

小麦嵌入式

FPGA入门（四）：时序逻辑计数器原理与 LED 闪烁实现哈喽大家好！在前几章我们学习了组合逻辑电路，这一章我们将正式进入时序逻辑电路的世界。时序逻辑是 FPGA 开发的核心，而计数器则是时序逻辑中最基础也最重要的单元之一。今天我们就从 D 触发器讲起，一步步实现一个基于计数器的 LED 闪烁项目，并通过仿真波形调试代码，彻底搞懂时序逻辑的工作原理。

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【黑金云课堂】FPGA技术教程FPGA基础：呼吸灯实验+RAM/ROM IP设计与验证FPGA 基础第 7-8 节呼吸灯实验+ RAM/ROM IP 设计与验证，选自 ALINX 黑金云课堂 FPGA 免费直播课。该课程由 ALINX 资深工程师团队倾力打造，从 0 到 1 系统化教学，帮助每位工程师跨过 FPGA 开发门槛。

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【黑金云课堂】FPGA技术教程Vitis开发：PS端IIC通信Vitis 开发第 8 节 PS IIC，选自 ALINX 黑金云课堂 FPGA 免费直播课。该课程由 ALINX 资深工程师团队倾力打造，从 0 到 1 系统化教学，帮助每位工程师跨过 FPGA 开发门槛。