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辣个蓝人QEX
2 个月前
fpga开发
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【FPGA开发】Xilinx FPGA差分输入时钟的使用方法
以前在使用ZYNQ的领航者ZYNQ7020进行FPGA学习时,它们使用的单端50M的输入时钟,在verlog代码编写上比较简单,而现在使用Alinx的AXU3EG开发板时,发现它使用的是200M的差分输入时钟,哪这个时候,输入时钟要怎么使用呢?
呜呼啦呼_l
7 个月前
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Xinlinx FPGA内的存储器BRAM全解
Xilinx 7系列fpga中的块RAM存储高达36 Kb的数据,可以配置为两个独立的18 Kb BRAM或一个36 Kb RAM。