复杂 SoC(RK3568)PCB 布局的五步

画一块搭载复杂 SoC(比如 RK3568 这种动辄几百个 BGA 焊盘的怪兽)的 PCB,就像是在巴掌大的地皮上规划一座微型城市。

很多时候,我们在调底层驱动时被频繁的内核 Panic、莫名其妙的设备重启,或者 I2C 总线狂报 -19 (No such device) 折磨得痛不欲生。查了半天设备树和驱动源码,最后往往会绝望地发现:其实是硬件布局从一开始就埋下了祸根。

PCB 布局如果顺序错了,后期走线时你就会痛苦地发现"路全被堵死了",最后只能推翻重来。新手最容易犯的致命错误,就是一上来先按着结构件的位置去布外围接口(比如以太网、显示座子)。

绝对不能先布外围接口! 行业标准的超经典布局顺序是:DDR -> 电源 (PMIC) -> 高速外设 (eMMC/PCIe/USB3) -> 接口 (以太网/显示) -> 低速杂项。

具体怎么落地?请严格遵循以下"五步走"战略。

🏗️ 第一步:绝对核心 ------ SoC 与 DDR(最优先)

这是整块板子最硬的骨头,没有任何商量的余地,必须第一个排布。

  • 为什么: DDR(无论是 DDR4 还是 LPDDR4)的工作频率极高。它对走线长度匹配、等长控制、阻抗以及拓扑结构(如 Fly-by 或 Point-to-Point)的要求极其严苛。稍微偏一点,系统就无法启动,或者在跑高负载应用时疯狂闪退。

  • 怎么做: 先把 RK3568 放在板子偏中心或规划好的核心区域,然后紧贴着它放置 DDR 芯片。必须留出足够的空间用于后期的蛇形等长绕线。同时,要把 RK3568 腹部(背面)的高频去耦电容(0402 或 0201 封装)见缝插针地先摆好,保证高频滤波效果。

⚡ 第二步:供电心脏 ------ 电源管理芯片 (PMIC,如 RK809)

DDR 的位置一旦定死,第二个必须立马安排的,就是主板的"心脏"------电源。

  • 为什么: SoC 满载跑内核、起图形界面或做 NPU 推理时,需要极大的瞬态电流。如果 PMIC 离得远,长长的走线会带来寄生电阻和电感,导致严重的压降(IR Drop)。表现在软件上,就是系统一跑重载任务就直接给你重启黑屏。

  • 怎么做: 将 PMIC 放在离 RK3568 电源引脚(尤其是 VDD_CPUVDD_LOGICVDD_GPU)最近的地方。

  • 划重点: PMIC 周围的储能大电感和输入/输出大电容必须紧凑排列,形成最小的回流环路。摆放这个时候,你的脑子里就应该已经构思好内层电源平面要怎么分割了。

🛣️ 第三步:高速干道 ------ eMMC、PCIe、USB 3.0

安顿好"大脑"和"心脏"后,就可以开始布置高速主干道了。

  • 为什么: 这些都是高速差分信号或高速并行信号,非常容易受到板内噪声的干扰,而且信号衰减极快。

  • 怎么做:

    • eMMC: 靠近主控的 eMMC 接口引脚放置,走线尽量短,且坚决不要有过多的打孔换层。

    • PCIe / USB 3.0: 如果有 M.2 接口或 USB 3.0 座子,先确认它们的物理摆放位置,然后确保从主控到座子的差分走线能拉直、拉短。最忌讳的就是高速差分线跨越地平面的分割区,那绝对是信号完整性的灾难。

🔌 第四步:对外窗口 ------ 以太网与显示接口

直到第四步,我们才开始处理结构相关的外部接口。

  • 为什么: 接口器件(如 RJ45 网口、HDMI 座子)的位置通常是被结构件外壳早早定死的。我们需要做的,是把相关的 PHY(物理层)芯片或 ESD 防护器件,合理地布置在主控与接口之间的必经之路上。

  • 怎么做:

    • 以太网: 将 PHY 芯片(如 RTL8211F)放在靠近 RJ45 网口的地方,而不是靠近主控。主控到 PHY 走的是相对低速的 RGMII 信号,而 PHY 到网口走的是脆弱的模拟差分信号。如果有变压器,必须紧贴网口,且变压器正下方的所有铺铜层都要掏空(挖地),做好隔离。

    • 显示接口(HDMI/MIPI): 同样,座子靠板边。ESD 防护器件必须紧贴座子放置(原则是:外界信号先进 ESD 被保护一下,再进入板内)。差分线尽量走直线。

🧩 第五步:边角余料 ------ 低速外设(UART、I2C、GPIO)

  • 布局原则: 这类信号(串口、I2C、SPI、按键、LED)由于速率较低,对走线长度和阻抗基本没什么要求。把它们见缝插针地塞在板子的边缘或空闲区域即可。说句夸张的,走线哪怕绕着板子跑半圈,通常也不会有什么致命问题。

💡 附录:RK3568 布局"避坑"指南

  1. 先整体,后局部: 千万不要一上来就死盯着一根线画。先把所有大芯片、座子按上面的顺序在板子上完成"摆盘"。打开"飞线(Ratsnest)"鸟瞰一下,看看整体的数据流向是否顺畅,有没有严重的交叉打结。

  2. 晶振的"风水": RK3568 旁边的 24MHz 主晶振,以及以太网 PHY 旁边的晶振,必须极度靠近各自的芯片!且晶振正下方的所有层 最好都要铺地隔离,绝对不允许有其他信号线从晶振底下穿过,否则必定引入难以排查的时钟串扰。

  3. 学会"抄作业": 瑞芯微(Rockchip)原厂都会提供现成的 EVB(评估板)PCB 源文件或 PDF 布局图。直接抄它的 DDR 和 PMIC 的相对位置! 原厂的工程师团队已经用无数次流片帮你把最优解算好了,千万别因为头铁而自己从零去"发明轮子"。

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