技术栈
ise
丁劲犇
13 天前
ai
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fpga开发
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架构
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trae
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b210
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b205mini
B205mini FPGA工程粗浅解析：从架构到Trae开发介绍
近期，采用ISE 环境结合AI Trae，成功自动化编译了 USRP B210/B205系列的FPGA工程，并在AI的协助下，初步了解了工程的结构，自动化产生了Bits, 下面把内容总结如下。
YprgDay
1 年前
fpga开发
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modelsim
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vivado
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lattice
《FPGA开发工具》专栏目录
Vivado工程创建、仿真、下载与固化全流程Vivado工程快速查看软件版本与器件型号Vivado IP核的快速入门 官方手册和例程
神仙约架
2 年前
fpga开发
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vivado
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xilinx
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ise
【XILINX】记录ISE/Vivado使用过程中遇到的一些warning及解决方案
XILINX/AMD是大家常用的FPGA，但是在使用其开发工具ISE/Vivado时免不了会遇到很多warning，(大家是不是发现程序越大warning越多？)，并且还有很多warning根据消除不了，看着特心烦？
whik1194
2 年前
fpga
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vivado
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xilinx
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管脚
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ise
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约束
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xdc
Xilinx FPGA管脚约束语法规则（UCF和XDC文件）
本文介绍ISE和Vivado管脚约束的语句使用，仅仅是管脚和电平状态指定，不包括时钟约束等其他语法。ISE使用UCF文件格式，Vivado使用XDC文件，Vivado中的MIG_DDR管脚也是使用的UCF文件。
我是有底线的