Xilinx XAPP585相关

XAPP585中相关的状态机

第一个状态机:这里主要是在对时钟线延迟的基础上,通过BITSLIP操作,做时钟的对齐;

第二个状态机:这里对c_delay_in所做的操作,主要是对时钟线的延迟进行控制;

delay_controller_wrap主要做了以下事情:

1、通过输入的延迟参数计算出,Data BUS上IDELAY模块所需要的延迟值;

2、通过将经IDELYA的数据输入到iSerdes进行解串后的数据,进行相应的延迟操作,进而得到延迟后的数据;

3、得到的延迟数据,将在后续经过gearbox_4_to_7进行4bit到7bit的转换操作;

注:单个 delay_controller_wrap 对一个line(解串后的4bit)进行延迟操作;

gearbox_4_to_7 模块的逻辑

相关推荐
第二层皮-合肥18 小时前
FPGA硬件设计-基础流程
fpga开发
第二层皮-合肥19 小时前
FPGA硬件开发-Xilinx产品介绍
fpga开发
XINVRY-FPGA20 小时前
XCVP1902-2MSEVSVA6865 AMD 赛灵思 XilinxVersal Premium FPGA
人工智能·嵌入式硬件·神经网络·fpga开发·云计算·腾讯云·fpga
热爱学习地派大星20 小时前
FPGA实现CRC校验
fpga开发
芒果树技术21 小时前
MT-PXle RIO模块【高性能FPGA+ LVDS】采用FPGA实现高效LVDS通讯
fpga开发·模块测试·fpga
明月清了个风1 天前
STM32初始化串口重定向后printf调试信息不输出的问题
stm32·单片机·fpga开发·嵌入式软件
通信小呆呆1 天前
电路思维下的 Verilog:如何区分组合逻辑与时序逻辑
fpga开发·电路·时序逻辑·跨时钟域·组合逻辑
嵌入式-老费1 天前
Zynq开发实践(FPGA之uart接收)
fpga开发
ShiMetaPi2 天前
操作【GM3568JHF】FPGA+ARM异构开发板 使用指南:蓝牙
arm开发·嵌入式硬件·fpga开发·rk3568
知识充实人生2 天前
静态时序分析详解之时序路径类型
fpga开发·时序路径·关键路径