【INTEL(ALTERA)】 quartus使用Nios® V 处理器系统仿真失败,没有打印输出消息

说明

在 Synopsys* VCS* 和 VCS* MX 仿真器中模拟由以下位置生成的 Nios® V 处理器系统时,可能会出现该问题:

  • 英特尔® Quartus® Prime Pro Edition 软件版本 23.1 至 23.4,或

  • 英特尔® Quartus® Prime Standard Edition 软件版本 23.1std

这是由于模拟器中的 X 传播支持。


解决方法

要解决此问题,请执行以下步骤

关闭 处理器内核上的 X 传播功能

  1. Platform Designer 生成 测试台系统

  2. 导航到 Synopsys* 模拟器目录。

    • $ cd <Project>/sys_tb/sys_tb/sim/synopsys
  3. -xprop=xpropconfig 附加至 vcs 或 vcsmx 文件夹内的 shell 脚本中。

例如:

  • USER_DEFINED_ELAB_OPTIONS="-xprop=xpropconfig"
  1. 在 vcs 或 vcsmx 文件夹 (在 shell 脚本旁边)中创建一个名为 xpropconfig 的文件

  2. 以下文本复制到 xpropconfig 中,并更改处理器实体名称。

tree {<Nios V 处理器 HDL 实体名称>} {xpropOff};

  1. 运行 模拟器

此问题当前计划英特尔® Quartus® Prime Pro Edition 软件版本 24.1 及更高版本中解决。

相关推荐
9527华安11 小时前
国产安路FPGA开发设计培训课程,提供开发板+工程源码+视频教程+技术支持
fpga开发·fpga·安路·视频教程·培训·安路fpga
UVM_ERROR18 小时前
硬件设计实战:解决Valid单拍采样失效问题(附非阻塞赋值与时序对齐核心要点)
驱动开发·fpga开发·github·芯片
brave and determined18 小时前
可编程逻辑器件学习(day36):从沙粒到智能核心:芯片设计、制造与封装的万字全景解析
fpga开发·制造·verilog·fpga·芯片设计·硬件设计·芯片制造
步达硬件1 天前
【FPGA】FPGA开发流程
fpga开发
我爱C编程2 天前
【仿真测试】基于FPGA的完整16QAM通信链路实现,含频偏锁定,帧同步,定时点,Viterbi译码,信道,误码统计
fpga开发·16qam·帧同步·卷积编码·viterbi译码·维特比译码·频偏锁定
s09071363 天前
ZYNQ DMA to UDP 数据传输系统设计文档
网络协议·fpga开发·udp
燎原星火*3 天前
QSPI IP核 基本参数
fpga开发
XINVRY-FPGA3 天前
XCVU9P-2FLGC2104I Xilinx AMD Virtex UltraScale+ FPGA
嵌入式硬件·机器学习·计算机视觉·fpga开发·硬件工程·dsp开发·fpga
FPGA_小田老师3 天前
FPGA Debug:PCIE一直自动重启(link up一直高低切换)
fpga开发·pcie debug·pcie初始化问题
hexiaoyan8273 天前
视频信号检测板卡:208-Base Camera Link 图像信号模拟器
fpga开发·图像信号模拟器·视频信号检测·视频信号分析·智能图像分析