【INTEL(ALTERA)】 quartus使用Nios® V 处理器系统仿真失败,没有打印输出消息

说明

在 Synopsys* VCS* 和 VCS* MX 仿真器中模拟由以下位置生成的 Nios® V 处理器系统时,可能会出现该问题:

  • 英特尔® Quartus® Prime Pro Edition 软件版本 23.1 至 23.4,或

  • 英特尔® Quartus® Prime Standard Edition 软件版本 23.1std

这是由于模拟器中的 X 传播支持。


解决方法

要解决此问题,请执行以下步骤

关闭 处理器内核上的 X 传播功能

  1. Platform Designer 生成 测试台系统

  2. 导航到 Synopsys* 模拟器目录。

    • $ cd <Project>/sys_tb/sys_tb/sim/synopsys
  3. -xprop=xpropconfig 附加至 vcs 或 vcsmx 文件夹内的 shell 脚本中。

例如:

  • USER_DEFINED_ELAB_OPTIONS="-xprop=xpropconfig"
  1. 在 vcs 或 vcsmx 文件夹 (在 shell 脚本旁边)中创建一个名为 xpropconfig 的文件

  2. 以下文本复制到 xpropconfig 中,并更改处理器实体名称。

tree {<Nios V 处理器 HDL 实体名称>} {xpropOff};

  1. 运行 模拟器

此问题当前计划英特尔® Quartus® Prime Pro Edition 软件版本 24.1 及更高版本中解决。

相关推荐
Saniffer_SH1 小时前
NAND技术(二):从 Channel、Die/LUN、P/E Cycle 到 LDPC,一次讲透 NAND 里那些最容易误解的概念
人工智能·驱动开发·嵌入式硬件·测试工具·fpga开发·计算机外设·压力测试
千寻xun1 小时前
二、实战篇-NVME SSD控制之ZYNQ实现(四)
fpga开发·nvme·nvme ssd
ALINX技术博客2 小时前
【黑金云课堂】FPGA技术教程Linux开发:系统进阶-PS DMA
linux·fpga开发
喵喵苗6 小时前
FPGA Verilog 入门避坑:寄存器与锁存器的本质区别 & 为什么时序逻辑缺 else 不会生成锁存器
fpga开发
Thinker3616 小时前
笔记本外接创新5.1声卡实战:M.2转PCIe软排线方案 vs 雷电扩展卡方案对比
fpga开发·声卡·笔记本外接pcie·显卡坞
传感器与混合集成电路10 小时前
136通道采集模块SPI接口设计:协议结构、时序要求与多模块级联扩展方案
fpga开发
ALINX技术博客1 天前
AMD MoP 封装策略解读 | HBM 大热,为何 AMD Versal 系列反选 LPDDR5X?
fpga开发·fpga·amd·versal
zlinear数据采集卡1 天前
从万用表的6步调零到硅片级微秒自校准:硬核拆解LHAMP188的宽压轨到轨与零漂移实战
arm开发·stm32·单片机·嵌入式硬件·fpga开发
Rambo.xia1 天前
AXI-Stream反压与背靠背传输——TREADY反压丢帧、TDEST路由错误、反压死锁,流式数据一反压就出事
fpga开发
传感器与混合集成电路1 天前
128路模拟通道轮询切换技术解析:模拟开关配置机制与精度影响抑制策略
嵌入式硬件·fpga开发