消除抖动模块code

消抖部分code

复制代码
`timescale 1ns / 1ps
//
// Company: 
// Engineer: 
// 
// Create Date: 2025/01/19 20:58:44
// Design Name: 
// Module Name: key_filter
// Project Name: 
// Target Devices: 
// Tool Versions: 
// Description: 
// 
// Dependencies: 
// 
// Revision:
// Revision 0.01 - File Created
// Additional Comments:
// 
//


module key_filter
    #(
        parameter   CNT_MAX =   20'd999_999
    )
    
    (

    input   wire    sys_clk         ,
    input   wire    sys_rst_n       ,
    input   wire    key_in          ,
    
    output  reg     key_flag

    );
    
    reg [19:0]  cnt_20ms    ;
    
    always@( posedge sys_clk or negedge sys_rst_n )
    begin
        if( sys_rst_n == 1'b0 )
        begin
            cnt_20ms    <=  20'd0   ;
        end
        else    if( key_in == 1'b1 )
        begin
            cnt_20ms    <=  20'd0   ;
        end
        else   if( cnt_20ms == CNT_MAX && key_in == 1'b0 )
        begin
            cnt_20ms    <=  cnt_20ms    ;
        end
        else
        begin
            cnt_20ms    <=  cnt_20ms    +   1'b1    ;
        end
    end
    
    always@( posedge sys_clk or negedge sys_rst_n )
    begin
        if( sys_rst_n == 1'b0 )
        begin
            key_flag    <=  1'b0    ;
        end
        else    if( cnt_20ms == CNT_MAX - 1'b1 )
        begin
            key_flag    <=  1'b1    ;
        end
        else
        begin
            key_flag    <=  1'b0    ;
        end
    end
    
endmodule

tb

复制代码
`timescale 1ns / 1ps
//
// Company: 
// Engineer: 
// 
// Create Date: 2025/01/19 21:28:47
// Design Name: 
// Module Name: tb_key_filter
// Project Name: 
// Target Devices: 
// Tool Versions: 
// Description: 
// 
// Dependencies: 
// 
// Revision:
// Revision 0.01 - File Created
// Additional Comments:
// 
//


module tb_key_filter();

    parameter   CNT_1MS        =       20'd19          ,
                 CNT_11MS       =       20'd69          ,
                 CNT_41MS       =       20'd149         ,
                 CNT_51MS       =       20'd199         ,
                 CNT_60MS       =       20'd249         ;
                                                                                                             
    wire        key_flag        ;
    reg         sys_clk         ;
    reg         sys_rst_n       ;
    reg         key_in          ;
    
    reg [21:0]  tb_cnt          ;
    
    initial
    begin
        sys_clk     =       1'b1        ;
        sys_rst_n   <=      1'b0        ;
        #20     ;
        sys_rst_n   <=      1'b1        ;
    end  
    always #10 sys_clk  =   ~sys_clk    ;
    
    //tb_cnt模拟抖动
    always@(posedge sys_clk or negedge sys_rst_n )
    begin
        if( sys_rst_n == 1'b0 )
        begin
            tb_cnt  <=  22'd0   ;
        end
        else if( tb_cnt == CNT_60MS )
        begin
            tb_cnt  <=  22'd0   ;
        end
        else 
        begin
            tb_cnt  <=  tb_cnt  + 1'b1  ;
        end       
    end 
    
    // key_in   模拟案件输入
    always@( posedge sys_clk or negedge sys_rst_n )
    begin
        if( sys_rst_n == 1'b0 )
        begin
            key_in  <=      1'b1        ;    
        end
        else if( (tb_cnt >= CNT_1MS && tb_cnt <= CNT_11MS)
                    ||
                 (tb_cnt >= CNT_41MS && tb_cnt <= CNT_41MS) 
               )
        begin
            key_in  <=      {$random}%2 ;
        end
        else if( tb_cnt >= CNT_11MS && tb_cnt <= CNT_41MS )
        begin
            key_in  <=      1'b0        ;
        end
        else
        begin
            key_in  <=      1'b1        ;
        end
        
    end                                                                                                                                          

    key_filter
    #(
        .CNT_MAX    (20'd24)
    )
    
    key_filter_inst
    (
        .sys_clk        (sys_clk)       ,
        .sys_rst_n      (sys_rst_n)     ,
        .key_in         (key_in)        ,
        
        .key_flag       (key_flag)
    );

endmodule

结果

相关推荐
乌恩大侠16 小时前
【OAI】 USRP 在conf文件中的配置,RU选项
fpga开发
qq_小单车2 天前
xilinx-DNA
fpga开发·xilinx
Flamingˢ2 天前
FPGA中的嵌入式块存储器RAM:从原理到实现的完整指南
fpga开发
Flamingˢ2 天前
FPGA中的存储器模型:从IP核到ROM的深度解析与应用实例
网络协议·tcp/ip·fpga开发
FPGA小c鸡2 天前
【FPGA深度学习加速】RNN与LSTM硬件加速完全指南:从算法原理到硬件实现
rnn·深度学习·fpga开发
Aaron15883 天前
通信灵敏度计算与雷达灵敏度计算对比分析
网络·人工智能·深度学习·算法·fpga开发·信息与通信·信号处理
博览鸿蒙3 天前
IC 和 FPGA,到底区别在哪?
fpga开发
思尔芯S2C3 天前
FPGA原型验证实战:如何应对外设连接问题
fpga开发·risc-v·soc设计·prototyping·原型验证
Flamingˢ3 天前
FPGA实战:VGA成像原理、时序详解与Verilog控制器设计与验证
fpga开发
FPGA_小田老师3 天前
xilinx原语:OSERDES2(并串转换器)原语详解
fpga开发·lvds·xilinx原语·oserdese·并串转换