XDMA pcie环路测试

图-1 测试框架图

一、上图中,主要用于测试XDMA的axilite寄存器访问和axi-memory大数据访问,图1完成了逻辑设计。

二、如果是windows环境,进行相关驱动开发,打驱动,然后进行应用层数据读写操作

参考:(WIN)S04-CH01 PCIE XDMA开发环境搭建以及环路测试 - 4-PCIE UISRC工程师开源站 -

三、如果是和ARM交互,那就是使用linux驱动,然后应用层进行数据读写操作

参考:https://www.scribd.com/document/812197356/04-Kintex-FPGA-%E4%BF%AE%E7%82%BC%E7%A7%98%E7%B1%8DPCIE%E9%AB%98%E7%BA%A7%E7%AF%87XDMA-LINUX-%E7%89%88%E6%9C%AC-B-Mk7325FA

相关推荐
坏孩子的诺亚方舟20 小时前
FPGA系统架构设计实践15_高云Arora V系列时钟体系
fpga开发·系统架构
FPGA小徐1 天前
入门 CNN 结构全解析|从流程图理论到 FPGA Verilog 硬件实现(含习题带讲解)
fpga开发
FPGA小徐1 天前
FPGA 数字信号处理:并行 FIR 与串行滤波器设计原理、对比与完整 Verilog 实现
fpga开发
Saniffer_SH2 天前
【高清视频】Gen6 服务器还没到,Gen6 SSD 怎么测?Emily 现场演示三种测试环境
人工智能·驱动开发·测试工具·缓存·fpga开发·计算机外设·压力测试
zlinear数据采集卡2 天前
双核架构深度解析:ARM+FPGA如何让数据采集卡实现500Ksps高性能?
arm开发·fpga开发·架构
9527华安2 天前
FPGA实现GTH Transceivers Wizard传输2路视频,基于aurora 8b10b编解码架构,提供4套工程源码和技术支持
fpga开发·gth·aurora 8b10b·transceivers
FPGA小徐3 天前
FPGA 数字信号处理(二):并行 FIR 滤波器的 Verilog 全流程设计与实现
fpga开发
国科安芯3 天前
基于AS32S601ZIT2型抗辐照MCU的商业航天卫星姿态确定与控制系统研究
单片机·嵌入式硬件·安全·fpga开发·架构·risc-v
ALINX技术博客3 天前
【黑金云课堂】FPGA技术教程FPGA基础:I2C 总线通信技术
fpga开发·i2c
Hello-FPGA3 天前
Xilinx KU040 FPGA Camera Link 图像采集
c++·fpga开发