技术栈
fpga系列 HDL : Microchip FPGA开发软件 Libero 中导出和导入引脚约束配置
FakeOccupational
2025-11-01 23:42
导出约束为***.pdc:
导入约束:
注:在Libero中没有LOCK的引脚在再次综合时可能会自动分配,即使两次使用相同的代码(相同的代码不能运行,花了很久才发现这个问题)。
如果出现类似Error: PDC-01: port name doesn't exist in the netlist or is not connected to an IoCell macro at的错误,可将PDC文件中对应的约束行删掉,重新配置
fpga开发
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