芯参谋(68):ADC模数转换器电路设计指南

先看清系统边界:ADC 只是链路的一段

把 ADC 的分辨率当成系统精度是最常见的误解:真实精度由前端驱动、参考电压、时钟与 Layout 共同决定,而且往往是前端拖后腿。

1.1 器件本质:采样保持 + 量化

ADC 先把输入电压采到采样电容上(采样保持),再与参考比较量化成码。采样瞬间会从输入端抽取电荷(charge kickback),如果前端不能在采样时间内把电压重新建立到所需精度,就会产生误差与失真------这是 ADC 前端设计的第一性问题。

ADC 的精度不是 ADC 一家的功劳:前端驱动、参考电压与 Layout 各占三分之一传感器 / 信号源幅度与源阻抗决定前端设计驱动运放阻抗变换 + 增益吸收采样反冲抗混叠 RC限带 + 供电荷与建立时间折中ADC采样保持 + 量化参考决定增益精度数字接口SPI / 并行时序与地噪声参考电压 VREF温漂即增益温漂参考精度直接决定增益精度一句话讲清信号链职责· 驱动运放负责「低阻 + 快速补充采样电荷」,抗混叠 RC 负责「限带 + 供电荷储能」。· ADC 本身的 INL/DNL 只是误差的一部分,参考电压的温漂与前端建立不足常常是更大的误差源。

图 1 · ADC 前端信号链

1.2 四类架构的边界

架构 分辨率 / 速率 优势 典型用途
SAR 8~18 bit / 100 k~5 MSPS 功耗低、延迟确定、易用 通用采集、电机控制、多通道
ΔΣ (Sigma-Delta) 16~24 bit / 几 k~几 MSPS 精度极高、内置数字滤波 精密测量、电能计量、音频
Pipeline 10~16 bit / 10~500 MSPS 高速与中等精度兼得 通信、视频、中频采样
Flash 6~8 bit / GSPS 级 极高速 示波器、雷达、光通信

1.3 动手前定死的四个输入

输入条件 为什么重要 没定死的后果
信号带宽与最高频率 决定采样率与抗混叠滤波 混叠导致数据完全错误且难以发现
目标有效精度(ENOB 而非分辨率) 决定架构与前端设计 标称 16 bit 实际只有 12 bit
输入范围与类型(单端/差分) 决定前端电路与共模处理 共模超限导致削波或失真
转换速率与通道切换方式 决定驱动能力与建立时间 首读偏差、采样率达不到

经验法则

先按**「带宽 + 有效精度」**定架构:慢速高精度选 ΔΣ,中速通用选 SAR,高速选 Pipeline。定完架构再回头设计前端------反过来做必然返工。

2. 目标应用产品与方案优势

凡是需要把物理量变成数字的地方都要 ADC:工业、能源、电机、音频、医疗、通信。

2.1 主要应用产品

目标应用产品图谱:终端产品 → 采集对象 → 典型规格档位工业传感器采集温度 / 压力 / 流量16~24 bit · ΔΣ电能计量电压电流同步采样16~24 bit · 多通道电机控制相电流与母线电压12~16 bit · 1~5 MSPS音频采集麦克风与线路输入16~24 bit · 高 SNR医疗仪器生物电信号16~24 bit · 低噪声通信设备中频与基带采样12~16 bit · 百 MSPS测试测量波形与精密测量16~18 bit · 高线性电池管理单体电压与电流12~16 bit · 多通道注:档位为工程常见区间,用于说明选型逻辑;实际方案按产品规格与 datasheet 核算

图 2 · ADC 应用图谱

终端产品 采集对象 本器件承担的角色 选型抓手
工业传感器采集 温度 / 压力 / 流量 把缓变物理量数字化 分辨率、温漂、噪声
电能计量 电压电流同步采样 功率与电能计算 多通道同步、线性度
电机控制 相电流与母线电压 电流环与保护采样 速率、延迟、同步采样
音频设备 麦克风与线路输入 高动态采集 SNR、THD、采样率
医疗仪器 生物电信号 微弱信号低噪声采集 噪声、CMRR、输入范围
通信设备 中频与基带 高速数字化 采样率、SFDR、抖动

2.2 方案优势

12~24 bit

常见分辨率区间

ΔΣ 可达 24 bit

1 k~500 MS

采样率区间

按架构划分

70~110 dB

SNR 量级

高精度型更高

±1~4 LSB

INL 量级

决定直流线性度

优势 机理 给产品带来的价值
数字化接口 直接输出码值 简化后级处理与传输
集成度高 内置参考、PGA、多路开关 减少外围器件与面积
灵活可配 速率与分辨率可切换 同一硬件覆盖多场景
成本跨度大 从几元到上百元 按需求精确选型

2.3 场景适配与选型边界

常见误用与边界

把分辨率当成精度是最常见的坑 :16 bit ADC 在高频输入、参考漂移、前端建立不足的情况下,有效位数可能只有 12 bit。另一个坑是忽略输入类型------差分输入 ADC 对共模电压有明确要求,单端接法往往直接超限。

结论

ADC 的真实精度 = 前端驱动能力 × 参考稳定性 × ADC 自身线性度,取其中最短的那块板。

3. 工作原理:采样、量化与关键指标

四个指标必须分清:分辨率、精度、有效位数、线性度。

3.1 静态指标:DNL / INL / 失调 / 增益

指标 含义 影响
失调误差 零输入时的码偏移 可校准,温漂部分难
增益误差 满量程斜率偏差 可校准,参考温漂部分难
DNL 相邻码宽度的偏差 DNL < −1 LSB 会丢码
INL 实际传输曲线偏离理想直线的最大值 决定直流线性度,不可校准

3.2 动态指标:SNR / THD / ENOB / SFDR

指标 含义 典型关系
SNR 信号与噪声功率比 理想 SNR ≈ 6.02·N + 1.76 dB
THD 谐波失真总量 前端失真与 ADC 非线性
SINAD 信号与噪声+失真比 SINAD = SNR 与 THD 的合成
ENOB 有效位数 ENOB = (SINAD − 1.76)/6.02

3.3 采样与混叠

采样频率必须大于信号最高频率的两倍(奈奎斯特),否则带外信号会混叠进带内 ,且混叠后的数据看起来完全正常------这是最难发现的错误。抗混叠滤波器不是可选项,其截止频率按采样率与信号带宽共同决定。

外围四件套:驱动运放、抗混叠 RC、参考源与去耦、干净的数字接口VINBUF单位增益反馈R1C1抗混叠 RCADC采样保持 + 量化差分 / 单端输入VREF 基准源低温漂 + 就近去耦VREFMCU / FPGASPI 读取与时序两条硬纪律· RC 的电容既是抗混叠滤波,也是采样瞬间给 ADC 供电荷的储能池:取值必须同时满足滤波与建立两个约束。· 参考电压就是增益基准:它的温漂直接等于增益温漂,必须按 ppm/°C 级选型并就近去耦。

图 3 · ADC 前端驱动与参考电路

4. 关键外围电路的设计要点

前端四件套:驱动运放、抗混叠 RC、参考源、数字接口隔离。

4.1 驱动运放与 RC 取值

  • 运放选择:带宽 ≥ 5~10 倍采样环路带宽;压摆率满足最大阶跃;输入偏置电流与噪声按精度选。
  • R 的作用:隔离运放与采样电容,保证运放稳定;阻值过小则运放振荡,过大则建立不足。
  • C 的作用:给采样瞬间供电荷(通常 ≥ 20~50 倍采样电容),同时构成抗混叠低通。
  • 取值流程:先按抗混叠截止频率定 RC 乘积,再按建立时间反推 R,最后校核运放稳定性。

4.2 参考电压

考量 要求 原因
温漂 按精度预算选 ppm/°C 参考温漂 = 增益温漂
噪声 低噪声基准 直接叠加到转换结果
驱动能力 必要时加缓冲运放 部分 ADC 参考电流随码变化
去耦 紧贴参考引脚,按 datasheet 选容值 参考不稳会显著恶化 INL
布局 参考走线短而粗、远离数字线 避免耦合噪声

4.3 数字接口与时钟

  • 时钟抖动:高速 ADC 的 SNR 上限由抖动决定:SNRjitter ≈ −20·log(2π·fin·tj)。
  • 数字回流:SPI 时钟与数据线的回流路径要可控,避免穿越模拟区。
  • 串行电阻:数字线上串 22~100 Ω 抑制过冲与振铃。

前端建立不足是看不见的精度杀手

运放带宽不够或 RC 时间常数过大时,采样电容在采样窗口内没充到位,表现为增益误差 + 失真,且随采样率升高而恶化。典型症状:低速采样时精度正常,一提高采样率精度就掉。

5. 典型应用电路与元件取值

以 16 bit SAR ADC、100 kSPS、0~5 V 单端输入为例,给出取值流程。

5.1 元件取值依据

元件 作用 取值要点
驱动运放 低阻驱动与增益 带宽 ≥10 MHz、压摆率 ≥10 V/µs、低噪声
R1 隔离与限流 10~50 Ω;与 C1 共同决定截止频率并保证运放稳定
C1 供电荷 + 抗混叠 ≥20~50 倍采样电容(典型 1~10 nF);选 C0G 或薄膜以保线性
VREF 转换基准 温漂 ≤10 ppm/°C(16 bit 要求);带缓冲输出
参考去耦 稳定参考 按 datasheet 选(常为 1~10 µF + 100 nF 组合)
数字串阻 抑制振铃 22~100 Ω,靠近驱动端

5.2 计算示例

设 ADC 采样电容 20 pF、采样窗口 300 ns、16 bit 建立要求(约 11 τ):C1 取 20 pF × 50 = 1 nF;RC 时间常数 τ = R1 × C1 需满足 11 τ < 300 ns → R1 < 27 Ω,取 20 Ω;抗混叠截止频率 fc = 1/(2π·20·1n) ≈ 8 MHz ------ 对 100 kSPS 的采样率而言,8 MHz 的带宽太宽,抗混叠不足。解决办法:**在运放级再加一级低通(有源滤波)**把带宽压到信号带宽的 2~5 倍,RC 只负责供电荷与稳定运放------这两个功能必须分开,靠一份 RC 兼顾两者往往两头不讨好。

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