TCL管理Vivado工程

文章目录

  • TCL管理Vivado工程
    • [1. 项目目录](#1. 项目目录)
    • [2. 导出脚本文件](#2. 导出脚本文件)
    • [3. 修改TCL脚本](#3. 修改TCL脚本)
      • [3.1 project.tcl](#3.1 project.tcl)
      • [3.2 bd.tcl](#3.2 bd.tcl)
    • [4. 工程恢复](#4. 工程恢复)

TCL管理Vivado工程

工程结构

1. 项目目录

  • config: 配置文件、coe文件等。
  • doc: 文档
  • fpga: 最后恢复的fpga工程目录
  • ip: ip文件
  • mcs: bit流文件等,方便直接使用
  • src: .v、.vh等源文件
  • tcl: 用来恢复工程的tcl脚本

2. 导出脚本文件

通过TCL Console 将目录切换到tcl目录。

  1. 生成新建工程tcl脚本

    在TCL Console执行

    tcl 复制代码
    write_project_tcl -use_bd_files {./project.tcl}
  2. 如果工程有bd文件,生成对应的tcl脚本用于恢复工程。

    ( 需要打开对应的bd文件,不打开会找不到)

    tcl 复制代码
    write_bd_tcl -no_ip_version {./bd.tcl}

    如果有多个bd文件,需要依次打开然后执行上述指令。

    -no_ip_version选项用于去除IP的版本信息,方便工程在高版本vivado中打开的情况。

  3. 生成IP文件脚本

    tcl 复制代码
    write_ip_tcl [get_ips ETH_RX_FIFO] {./ip.tcl}

    这里采用将原工程中ip的xci文件直接拷贝到ip目录中的方式。

  4. 添加仿真文件和约束文件

    将原工程的源文件、仿真文文件、约束文件拷贝到src目录下。

    • vcode中存放源文件
    • xdc中存放约束文件

3. 修改TCL脚本

3.1 project.tcl

  1. 修改工程路径

    tcl 复制代码
    将
    set origin_dir "."
    修改为
    set origin_dir [ file dirname [ info script ] ]  
  2. 修改_xil_proj_name_即可更改工程名字

    tcl 复制代码
    set _xil_proj_name_ "promanagement"
  3. 修改恢复后工程的存放路径( 这里希望生成的工程在fpga目录下)

    tcl 复制代码
    将
    # Create project
    create_project ${_xil_proj_name_} ./${_xil_proj_name_} -part xc7z020clg484-1
    修改为
    create_project ${_xil_proj_name_} ../fpga/${_xil_proj_name_} -part xc7z020clg484-1
  4. 修改block design相关的配置

    tcl 复制代码
    将
    set files [list \
     [file normalize "${origin_dir}/../../promanagement/promanagement.srcs/sources_1/bd/system/system.bd" ]\
     [file normalize "${origin_dir}/../../promanagement/promanagement.srcs/sources_1/bd/system/hdl/system_wrapper.v" ]\
     [file normalize "${origin_dir}/../../promanagement/promanagement.srcs/sources_1/new/top.v" ]\
    ]
    set imported_files [import_files -fileset sources_1 $files]
    
    # Set 'sources_1' fileset file properties for remote files
    # None
    
    # Set 'sources_1' fileset file properties for local files
    set file "system/system.bd"
    set file_obj [get_files -of_objects [get_filesets sources_1] [list "*$file"]]
    set_property -name "registered_with_manager" -value "1" -objects $file_obj
    修改为
    # Create block design
    source $origin_dir/bd.tcl
    
    # Generate the wrapper
    set design_name [get_bd_designs]
    make_wrapper -files [get_files $design_name.bd] -top -import
    set files [list \
        [file normalize "${origin_dir}/../src/vcode/top.v" ]\
    ]
    set imported_files [import_files -fileset sources_1 $files]
  5. 修改v文件配置
    在上一步的修改内容中实际上已经进行了配置

  6. 修改ip文件配置

    tcl 复制代码
    将
    set files [list \
     [file normalize "${origin_dir}/../../promanagement/promanagement.srcs/sources_1/ip/clk_wiz_0/clk_wiz_0.xci" ]\
    ]
    修改为
    set files [list \
     [file normalize "${origin_dir}/../ip/clk_wiz_0/clk_wiz_0.xci" ] \
    ]
  7. 修改约束文件配置

    tcl 复制代码
    将
    set file "new/top.xdc"
    set file_obj [get_files -of_objects [get_filesets constrs_1] [list "*$file"]]
    set file "[file normalize "$origin_dir/../../promanagement/promanagement.srcs/constrs_1/new/top.xdc"]"
    修改为
    set file "xdc/top.xdc"
    set file_obj [get_files -of_objects [get_filesets constrs_1] [list "*$file"]]
    set file "[file normalize "$origin_dir/../src/xdc/top.xdc"]"

3.2 bd.tcl

tcl 复制代码
将
set list_projs [get_projects -quiet]
if { $list_projs eq "" } {
   create_project project_1 myproj -part xc7z020clg484-1
}
注释掉

4. 工程恢复

tcl 复制代码
source project.tcl
相关推荐
上理考研周导师5 小时前
第二章 虚拟仪器及其构成原理
fpga开发
FPGA技术实战6 小时前
《探索Zynq MPSoC》学习笔记(二)
fpga开发·mpsoc
bigbig猩猩17 小时前
FPGA(现场可编程门阵列)的时序分析
fpga开发
Terasic友晶科技21 小时前
第2篇 使用Intel FPGA Monitor Program创建基于ARM处理器的汇编或C语言工程<二>
fpga开发·汇编语言和c语言
码农阿豪1 天前
基于Zynq FPGA对雷龙SD NAND的测试
fpga开发·sd nand·spi nand·spi nand flash·工业级tf卡·嵌入式tf卡
江山如画,佳人北望1 天前
EDA技术简介
fpga开发
淘晶驰AK1 天前
电子设计竞赛准备经历分享
嵌入式硬件·fpga开发
最好有梦想~1 天前
FPGA时序分析和约束学习笔记(4、IO传输模型)
笔记·学习·fpga开发
檀越剑指大厂1 天前
【基于Zynq FPGA对雷龙SD NAND的测试】
fpga开发