FPGA----完美解决Windows下[XSIM 43-3409][XSIM 43-3915]错误

大家好久不见,今天开始又要重操旧业了!最近会更新很多关于petalinux的踩坑日记,敬请期待!

先更新一个常见问题,使用Vivado仿真时C编译器报错问题。如下所示

复制代码
ERROR: [XSIM 43-3409] Failed to compile generated C file xsim.dir/testbench_behav/obj/xsim_1.c. 
ERROR: [XSIM 43-3915] Encountered a fatal error. Cannot continue. Exiting... 

这个问题是由于windows环境变量配置引起的,Vivado有自己的C编译器,但是如果你Windows也配置了C编译器则会引起错误。

1、首先在TCL输入:

复制代码
exec xelab -mt off -v 1 -debug typical work.testbench

则会提示好多红色错误,我提示的有3个环境变量冲突了:MW_MINGW64_LOC、C_INCLUDE_PATH、LIBRARY_path

复制代码
MW_MINGW64_LOC     C:\TDM-GCC-64


C_INCLUDE_PATH  c:\mingw\include



LIBRARY_path   c:\mingw\lib

2、在系统环境变量删掉这几个冲突的就能仿真啦!(记得备份哦~)

3、我是因为Matlab需要调用外部C编译器引起的,为解决这个问题,我们可以在Matlab的toolbox/local文件夹内创建startup.m文件

Matlab 复制代码
function startup()
setenv('MW_MINGW64_LOC', 'C:/TDM-GCC-64');
setenv('C_INCLUDE_PATH', 'c:/mingw/include');
setenv('LIBRARY_path', 'c:/mingw/lib');
end
相关推荐
9527华安2 小时前
FPGA纯verilog实现DP视频接口,支持2K60帧分辨率,提供3套工程源码和技术支持
fpga开发·音视频·dp
ChaseVLSI13 小时前
FPGA与ASIC的区别详解:内部结构、开发成本与适用场景,项目选型到底该选哪个
嵌入式硬件·fpga开发·硬件架构·硬件工程
9527华安1 天前
FPGA实现ARINC818总线协议,基于GT Transceivers Wizard高速收发器,提供7套工程源码和技术支持
fpga开发·transceivers·arinc818
小蘇的FPGA1 天前
fpga-wide-data-crc32
fpga开发
落雨无风2 天前
fpga板级调试常见问题
fpga开发
码农小韩2 天前
FPGA学习(一)——LED点灯与开发流程
学习·fpga开发·入门·环境配置·仿真·点灯
FPGA小迷弟2 天前
FPGA 与千兆以太网:各类物理接口的形式、区别、使用方法与应用场景详解
tcp/ip·macos·fpga开发·udp·fpga
NamoAmitabha1282 天前
Zynq 的 AXI GPIO,是“ARM 通过一条国际标准高速公路(AXI 总线),去遥控 FPGA 里的一个寄存器”。---deepseek
fpga开发·zynq--ps
NamoAmitabha1282 天前
ARM 不懂寄存器,它只懂内存地址---deepseek
fpga开发·zynq--ps
FPGA小迷弟3 天前
FPGA 千兆以太网帧格式全解:从 IEEE 802.3 帧结构到 Verilog 收发实现
人工智能·5g·fpga开发·架构·硬件架构