FPGA(或者数字电路)中组合逻辑和时序逻辑是怎么划分的

1.组合逻辑

在FPGA中,组合逻辑是哪些没有触发器作为存储单元的电路

LUT查找表就是组合逻辑电路,无时钟信号参与。

加法器,逻辑门,多路选择器,译码器

2.时序逻辑电路

输出依赖于当前输入,还依赖于过去

触发器,寄存器,计数器,状态机

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