多片RFSoC同步,64T 64R

挖个坑,验证测试多片47/49dr同步方案可行性,每个LMK04828采用 Zero delay mode (ZDM)

参考资料:

1、https://iwave-global.com/articles/multi-board-synchronization-on-rfsoc-board-and-systems/

2、https://adaptivesupport.amd.com/s/question/0D54U00007UkaLdSAJ/how-to-setup-multiboard-synchronization-how-do-we-evaluate-it?language=en_US

3、https://www.interwiser.com/?mod=cases_detail&id=7

4、https://rfsoc.net/mrf16#

5、https://www.ti.com/lit/ds/symlink/lmk04828.pdf?ts=1753089154048

6、Multi-ClockSynchronization


1、所有RFSoC上的Analog SYSREF、PL_SYSREF、PL_CLK 和 sampling clock 应该相位对齐

2、各个LMK04828 需要一个公共输入参考时钟,消除不同输入源之间的相位差

3、LMK04828 芯片的ZDM模式将确保输出时钟(SYSREF、PL_CLK 和 sampling clock)与公共输入参考时钟相位锁定

图来源:https://rfsoc.net/mrf16#

图来源:https://mp.weixin.qq.com/s/KAyK8p3yLFvkCv-GOao4cw

图来源:https://www.interwiser.com/?mod=cases_detail&id=7

看看各个通道间的相位一致性和幅度一致性

相关推荐
Oflycomm1 小时前
Wi-Fi 8 标准还没定,为什么 TP-Link 已经开始预售了?
物联网·无线通信·wifi7·wifi8·802.11bn
一口一口吃成大V3 小时前
Fpga中常用器件
fpga开发
Riwuarua5 小时前
从近似0基础开始FPGA开发——Part.23:AXI/AXIS 数据搬运、DMA 与 DDR 缓存架构设计
缓存·fpga开发
NamoAmitabha1285 小时前
xilinx/MMCM/DRP/使用
fpga·xilinx·mmcm
Jason_zhao_MR9 小时前
电力数据采集核心板选型指南
linux·嵌入式硬件·fpga开发·嵌入式
长春的KAKA11 小时前
Proxmark3 RDV4.01:Windows 11 下 Iceman 固件升级与完整使用指南
fpga开发
Apipi*20 小时前
30天速通Linux 第六章信号及信号处理
linux·运维·信号处理
奋斗的阿狸_19861 天前
ESP32-S3 + ES7210 四通道麦克风录音上传方案
c语言·开发语言·fpga开发
hahaha60161 天前
FPGA+ARM实现AWB的全流程
人工智能·嵌入式硬件·算法·计算机视觉·fpga开发
unicrom_深圳市由你创科技1 天前
板上调试,先抓哪些信号?排查顺序是什么?
fpga开发