目录
[1. 眼图概述](#1. 眼图概述)
[2. 眼图形成原理](#2. 眼图形成原理)
[3. 眼图关键参数](#3. 眼图关键参数)
[4. 眼图模板](#4. 眼图模板)
[5. 常见眼图问题](#5. 常见眼图问题)
[6. 眼图优化](#6. 眼图优化)
1. 眼图概述
眼图（Eye Diagram）是高速串行信号物理层时域测试方法。利用恢复时钟（CDR）作为触发基准，将大量连续符号波形按单个符号周期 UI 叠加显示，波形叠加后形似人眼，因此称为眼图。
核心目的：一次性直观评估信号质量，判断接收端能否正确采样识别 0/1。
核心思想：把不同码型的波形，按**符号周期（UI，Unit Interval）**做同步叠加，所有可能的跳变组合重叠在一起，一次性看出信号质量。
眼图（Eye Diagram）是高速数字电路设计和信号完整性（Signal Integrity, SI）分析中最核心的评估工具。在高速数字系统中，信号是由一连串的"0"和"1"组成的，以码元周期（即单位间隔 UI）为基准进行时间对齐，在时域中内进行无限次的叠加与累积就会形成眼图。
眼图是信号完整性（SI）最重要的工具，主要原因如下：
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直观：可以直接肉眼判断信号质量优劣，不用单独分析复杂的单路时域波形。
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统计性：不是只测量单个比特，是数十万次采样叠加得到的统计结果，能体现噪声、抖动这类随机特性。
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标准统一：USB、HDMI、PCIe、以太网（Ethernet）等高速总线协议，都定义了对应的眼图掩码模板，测试判定规则统一。
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可量化：能够直接提取眼高、眼宽、抖动等指标，和协议规格做定量对比，不只是定性观察。
2. 眼图形成原理
眼图是将高速串行数据流，以符号周期 UI 为基准做同步叠加 得到的统计波形图。示波器利用CDR 恢复时钟作为触发基准，把连续串行比特流切分成无数个 UI 窗口，全部叠加在同一个时间轴上，所有码型的跳变边沿重叠在一起，形成类似眼睛的轮廓，即眼图。
核心原理：示波器将采集到的数字信号按符号周期对齐、叠加，在屏幕形成形似 "眼睛" 的图案，直观评估信号完整性，反映噪声、抖动、码间干扰（ISI）等信号缺陷。
眼图的形成原理可分为以下四个核心步骤：
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信号捕获与采样 使用实时示波器或采样示波器对高速数字信号连续采样，采集原始电压 - 时间波形数据。为保证信号完整还原，示波器采样率需远高于信号速率，一般满足采样定理 3~5 倍以上过采样。
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时钟恢复（关键步骤） 从接收数据流中提取同步时钟（通过硬件 PLL 锁相环或软件 CDR 算法），作为波形叠加的对齐触发基准。时钟恢复精度直接影响波形对齐质量；时钟恢复偏差会造成眼图模糊、倾斜，眼孔提前闭合。
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分段对齐 将连续数据流按照单个符号周期 UI（Unit Interval，UI = 1 / 数据速率）进行切片，截取每一段 UI 波形，并全部对齐至同一个时间窗口。"000、011、101、111" 等各类随机码型对应的波形片段，都会统一对齐。
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累积叠加与成图 将全部对齐后的波形片段做累积叠加（依靠示波器余辉模式或软件统计叠加）。叠加的波形样本数量越多，眼图统计结果越可靠。波形轨迹出现概率高的区域显示为亮色（眼皮）；轨迹极少出现的区域为眼孔开窗，最终生成幅度 - 时间二维概率密度图，即眼图。
对于数字信号来说，其高电平与低电平的变化可以有多种序列组合。以3个bit为例，有000~111共8种组合。在时域上将足够多的上述序列按某一个基准点对齐，然后将其波形叠加起来，就形成了眼图。
示波器首先捕获一组连续比特位的信号，然后用软件PLL方法恢复出时钟，最后利用恢复出的时钟和捕获到的信号按比特位切割，切割一次，叠加一次，最终将捕获到的一组数据的每个比特位都叠加到了眼图上。其示意图如下：
3. 眼图关键参数
眼图的核心参数包含 UI、眼幅、眼高、眼宽、交叉点与抖动：UI 为单个符号的时间间隔，是时间测量基准；眼幅代表高低电平平均值之差，主要受通道损耗影响；眼高是眼中心扣除噪声后的垂直开窗，反映电压余量；眼宽代表水平有效开窗，体现抖动带来的时间余量；交叉点表征信号高低电平跳变交汇位置，可判断差分信号不对称与占空比失真；抖动描述信号边沿的时间不确定性，分为总抖动 TJ、确定性抖动 DJ 与随机抖动 RJ；同时可结合眼图掩码与 BER 轮廓，在指定误码率条件下对信号质量做标准化判定，用于评估高速串行信号的信号完整性。
| 参数 | 简要说明 |
|---|---|
| UI | 符号间隔，单个符号时间宽度，UI=1 / 比特率 |
| 眼幅 Eye Amplitude | 1 电平均值与 0 电平均值之差，不含噪声，由通道损耗决定 |
| 眼高 Eye Height | 眼中心位置垂直开窗，扣除噪声后的有效电压余量，常用 EH@1e-12 |
| 眼宽 Eye Width | 眼中心水平开窗，反映抖动大小，代表采样时间余量 |
| 交叉点 Cross Point | 上升沿、下降沿交汇位置（% 幅度），反映差分不对称、占空比失真 |
| Jitter 抖动 | 信号边沿的时间不确定性，分为 TJ 总抖动、DJ 确定性抖动、RJ 随机抖动 |
| Mask 掩码 | 协议规定禁止信号侵入的模板，侵入即测试失败 |
| BER 轮廓 | 指定误码率（典型 1e-12）的等概率线，现代协议用来定义眼高 / 眼宽 |
4. 眼图模板
眼图模板（眼图掩码）是高速串行协议预先定义在眼图上的禁止侵入区域，是一个多边形轮廓模板，叠加在眼图之上。任何信号轨迹不能进入掩码区域；一旦波形侵入掩码，判定测试失败。
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协议定制：不同总线标准（PCIe、USB3、MIPI、GMSL、车载以太网）拥有各自独立的 Mask 模板，模板形状、尺寸、位置由协议规范规定。
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测量基准：模板放置在 UI 符号周期内，以眼中心、判决电平为基准，定义垂直电压边界与水平时间边界。
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物理含义：掩码内部是不允许信号到达的区域，代表接收端无法可靠采样判决 0/1 的危险区间。
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和 BER 轮廓区别：传统 Mask 是固定几何模板；现代高速协议采用BER 轮廓（BER Contour），基于指定误码率（如 1e-12）的概率边界来判定开窗。
| 协议 / 接口 | 模板坐标单位 | 关注点 |
|---|---|---|
| PCIe (Gen3 及以上) | mV-UI / mV-ps | 发送端眼图 + 接收端容限 (含均衡) |
| USB3.x / USB4 | mV-ps | 发送端眼图 + 抖动预算 |
| 10GBASE-KR 以太网 | mV-UI | 发送端模板 + BER <1e-12 |
| SATA / SAS | mV-ps | 发送端模板 |
| DDR4 / DDR5 | mV-ps，或数据有效窗口 tDVW | 接收窗口约 1/3 UI 量级，重点看眼宽 |
| MIPI D-PHY / C-PHY | mV-ps | 移动端低摆幅，模板尺寸更小 |
眼图模板（Mask）大多为六边形（六边多边形） ，也有部分协议使用菱形。不会采用简单矩形。
模板是电平限制 与时间（抖动 + ISI）限制两者的折中：
- 上下两条水平边 ：由电平噪声约束。用来限制 0 电平不能抬太高、1 电平不能降太低，规定垂直方向电压余量。
- 左右斜边 / 尖角 ：由抖动 + 码间干扰 ISI约束。越靠近眼中心判决点，允许的电压波动越小；离判决点越远，对幅度要求越严格，因此左右不是垂直直线，而是倾斜斜边。
六边形用最少拐点，把全部合规的电压 - 时间区域完整包出来，兼顾垂直噪声与水平抖动的约束。
5. 常见眼图问题
眼图常见问题主要分垂直和水平两类：
- 垂直上噪声、损耗、ISI 会压缩眼高；
- 水平方向抖动压缩眼宽。
还会出现交叉点偏移、振铃过冲、眼图不对称。当眼图轨迹跑进掩码区域，就代表信号不合格，存在误码风险。
| 眼图现象 | 直观特征 | 根因 | 带来后果 |
|---|---|---|---|
| 眼高不足（上下眼皮厚） | 垂直方向眼孔压缩，眼皮变厚 | 通道损耗、电源噪声、串扰、ISI 码间干扰 | 电压余量不足，容易误判高低电平 |
| 眼宽不足（左右压扁） | 水平方向开窗收窄 | 总抖动 TJ 大（DJ 确定性抖动 + RJ 随机抖动） | 采样时间余量不够，容易采样出错 |
| 眼图单边不对称 | 上下眼皮厚薄不一致、交叉点偏移 | 差分 skew、占空比失真 DCD、驱动器不对称、阻抗反射 | 单边余量提前耗尽，局部侵入 mask |
| 眼皮有毛刺 / 噪点多 | 眼皮粗糙、颗粒感强 | 电源纹波、邻近通道串扰、示波器探头噪声 | 垂直噪声大，眼高降低 |
| 眼图侵入掩码 Mask | 波形进入协议禁区 | 噪声、抖动、ISI、阻抗不连续反射、衰减过大 | 测试直接 Fail，存在误码风险 |
| 眼图畸形 / 不完整 | 眼轮廓残缺、缺少部分轨迹 | 测试码型不全（短码，非 PRBS） | 不能真实评估信号，测试无效 |
| 过冲 / 振铃 | 眼皮外侧出现尖峰 | 阻抗不匹配、反射、带宽不足 | 超出电压额定范围，损伤接收端 |
6. 眼图优化
想要撑开眼图，可以从发送端均衡、摆幅、边沿速率、接收端均衡、PCB 通道这几方面入手；所有改善手段都有副作用，需要在眼图余量、功耗、EMI、成本之间做权衡。
核心思想：眼图质量由发送端 + 传输通道 + 接收端共同决定。下面这些方法，目的都是把眼图的眼高、眼宽 "撑开"，但每种方案都有代价。
| 手段 | 作用机理 | 对眼高 | 对眼宽 | 代价 |
|---|---|---|---|---|
| 去加重 / 预加重 (Tx FFE) | 压低长连码的低频幅度，相对抬高高频，预补偿通道低通衰减 | 明显提升 | 略改善 | 输出摆幅下降，EMI 可能变化 |
| 提高发送摆幅 | 直接加大信号眼幅 | 提升 | 基本不变 | 功耗上升、EMI 增大，受协议上限约束 |
| 减小边沿时间 | 减弱码间干扰 ISI | 提升 | 提升 | 功耗、EMI 增加，对芯片硬件带宽要求更高 |
| 接收端 CTLE | 在接收端抬高高频分量，补偿通道损耗 | 提升 | 提升 | 同时放大高频噪声，噪声抬升后眼高反而可能恶化 |
| 接收端 DFE | 用判决反馈消除后游标 (post-cursor) ISI | 提升 | 提升 | 对前游标 ISI 无效，存在误判风险 |
| 更短走线 / 更低损耗板材 | 直接减小通道插损 | 提升 | 提升 | 成本增加，受 PCB 叠层、板材工艺限制 |
| 改善阻抗连续性、回损 | 减少阻抗反射带来的 ISI | 提升 | 略改善 | 需要优化连接器、过孔，设计投入更高 |
